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關(guān)于邏輯電平一些概念

文章出處:http://m.botanicstilllife.com 作者:興邦開(kāi)發(fā)部 人氣: 發(fā)表時(shí)間:2016年06月28日

[文章內(nèi)容簡(jiǎn)介]:關(guān)于邏輯電平一些概念

要了解邏輯電平的內(nèi)容,首先要知道以下幾個(gè)概念的含義:

1:輸入高電平(Vih): 保證邏輯門(mén)的輸入為高電平時(shí)所允許的最小輸入高電平,當(dāng)輸入電平高于Vih時(shí),則認(rèn)為輸入電平為高電平。

2:輸入低電平(Vil):保證邏輯門(mén)的輸入為低電平時(shí)所允許的最大輸入低電平,當(dāng)輸入電平低于Vil時(shí),則認(rèn)為輸入電平為低電平。

3:輸出高電平(Voh):保證邏輯門(mén)的輸出為高電平時(shí)的輸出電平的最小值,邏輯門(mén)的輸出為高電平時(shí)的電平值都必須大于此Voh。

4:輸出低電平(Vol):保證邏輯門(mén)的輸出為低電平時(shí)的輸出電平的最大值,邏輯門(mén)的輸出為低電平時(shí)的電平值都必須小于此Vol。

5:閥值電平(Vt): 數(shù)字電路芯片都存在一個(gè)閾值電平,就是電路剛剛勉強(qiáng)能翻轉(zhuǎn)動(dòng)作時(shí)的電平。它是一個(gè)界于Vil、Vih之間的電壓值,對(duì)于CMOS電路的閾值電平,基本上是二分之一的電源電壓值,但要保證穩(wěn)定的輸出,則必須要求輸入高電平> Vih,輸入低電平<Vil,而如果輸入電平在閾值上下,也就是VilVih這個(gè)區(qū)域,電路的輸出會(huì)處于不穩(wěn)定狀態(tài)。

對(duì)于一般的邏輯電平,以上參數(shù)的關(guān)系如下:

Voh > Vih > Vt > Vil > Vol。

6Ioh:邏輯門(mén)輸出為高電平時(shí)的負(fù)載電流(為拉電流)。

7Iol:邏輯門(mén)輸出為低電平時(shí)的負(fù)載電流(為灌電流)。

8Iih:邏輯門(mén)輸入為高電平時(shí)的電流(為灌電流)。

9Iil:邏輯門(mén)輸入為低電平時(shí)的電流(為拉電流)。

     門(mén)電路輸出極在集成單元內(nèi)不接負(fù)載電阻而直接引出作為輸出端,這種形式的門(mén)稱為開(kāi)路門(mén)。開(kāi)路的TTLCMOS、ECL門(mén)分別稱為集電極開(kāi)路(OC)、漏極開(kāi)路(OD)、發(fā)射極開(kāi)路(OE),使用時(shí)應(yīng)審查是否接上拉電阻(OC、OD門(mén))或下拉電阻(OE門(mén)),以及電阻阻值是否合適。對(duì)于集電極開(kāi)路(OC)門(mén),其上拉電阻阻值RL應(yīng)滿足下面條件:

1): RL < VCCVoh/n*Iohm*Iih

2):RL > VCCVol/Iolm*Iil

其中n:線與的開(kāi)路門(mén)數(shù);m:被驅(qū)動(dòng)的輸入端數(shù)。

:常用的邏輯電平

·邏輯電平:有TTL、CMOS、LVTTLECL、PECLGTL;RS232、RS422、LVDS等。

·其中TTLCMOS的邏輯電平按典型電壓可分為四類:5V系列(5V TTL5V CMOS)、3.3V系列,2.5V系列和1.8V系列。

·5V TTL5V CMOS邏輯電平是通用的邏輯電平。

·3.3V及以下的邏輯電平被稱為低電壓邏輯電平,常用的為LVTTL電平。

·低電壓的邏輯電平還有2.5V1.8V兩種。

·ECL/PECLLVDS是差分輸入輸出。

·RS-422/485RS-232是串口的接口標(biāo)準(zhǔn),RS-422/485是差分輸入輸出,RS-232是單端輸入輸出。

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